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ABB PCD235B101 3BHE032025R0101 勵磁控制系統(tǒng)

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VLIW CPU 通常由多個獨(dú)立運(yùn)行的類 RISC執(zhí)行單元組成?，F(xiàn)代 VLIW 通常有四到八個主要執(zhí)行單元。編譯器以與傳統(tǒng) CPU 大致相同的方式為 VLIW CPU 生成初始指令序列，生成一系列類似 RISC 的指令。編譯器分析此代碼的依賴關(guān)系和資源需求。然后它會根據(jù)這些約束來安排指令。在這個過程中，可以并行調(diào)度獨(dú)立的指令。由于 VLIW 通常表示與包含各個指令的較長指令字并行調(diào)度的指令，因此這會導(dǎo)致更長的操作碼（稱為非常長) 來指定在給定周期執(zhí)行什么。

當(dāng)代 VLIW CPU 的示例包括NXP（前身為 Philips Semiconductors）的TriMedia媒體處理器、 Analog Devices 的超級哈佛架構(gòu)單芯片計(jì)算機(jī)(SHARC) DSP、 STMicroelectronics 基于 Lx 架構(gòu)（在 Josh Fisher 的 HP 中設(shè)計(jì)）的ST200 系列Paolo Faraboschi 的實(shí)驗(yàn)室）、Fujitsu的FR-V 、 Pixelworks的BSP15/16 [8]、 CEVA 的CEVA-X DSP、 Improv Systems 的Jazz DSP 、 Silicon Hive 的HiveFlex [9]系列，以及Kalray 的 MPPA Manycore 系列。德州儀器 與早期的C5000系列相比， TMS320 DSP系列在其C6000系列中已經(jīng)發(fā)展到看起來更像 VLIW 。這些現(xiàn)代 VLIW CPU 主要成功地用作消費(fèi)電子設(shè)備的嵌入式媒體處理器。

VLIW 功能也已添加到片上系統(tǒng)(SoC) 設(shè)計(jì)的可配置處理器內(nèi)核中。例如，Tensilica 的Xtensa LX2 處理器采用了一種名為靈活長度指令擴(kuò)展 (FLIX) 的技術(shù)，該技術(shù)允許執(zhí)行多操作指令。Xtensa C/C++ 編譯器可以將 32 位或 64 位 FLIX 指令與 Xtensa 處理器的 16 位或 24 位寬的單操作 RISC 指令自由混合。通過將多個操作打包到一個寬的 32 位或 64 位指令字中，并允許這些多操作指令與較短的 RISC 指令混合，F(xiàn)LIX 允許 SoC 設(shè)計(jì)人員實(shí)現(xiàn) VLIW 的性能優(yōu)勢，同時消除代碼膨脹早期的 VLIW 架構(gòu)。Infineon Carmel DSP 是另一個用于 SoC 的 VLIW 處理器內(nèi)核。它使用一種類似的代碼密度改進(jìn)方法，稱為可配置長指令字(CLIW)。[10]

在嵌入式處理市場之外，Intel 的Itanium IA-64顯式并行指令計(jì)算(EPIC) 和Elbrus 2000是廣泛使用的 VLIW CPU 架構(gòu)的僅有例子。然而，EPIC 體系結(jié)構(gòu)有時與純 VLIW 體系結(jié)構(gòu)有所區(qū)別，因?yàn)?EPIC 提倡完整的指令預(yù)測、旋轉(zhuǎn)寄存器文件和可以編碼非并行指令組的非常長的指令字。VLIW 在圖形處理單元(GPU) 市場也獲得了顯著的消費(fèi)者滲透，盡管Nvidia和AMD此后都轉(zhuǎn)向 RISC 架構(gòu)以提高非圖形工作負(fù)載的性能。

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